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VHDL/Verilogなら俺にきけ

1 :デフォルトの名無しさん:2008/10/28(火) 21:35:37
VHDLで電卓を作ろうと思ってます。
10進表示にしたいのですがどうしても
16進にしかなりません。
誰か教えて教えてくれませんか??

2 :デフォルトの名無しさん:2008/10/28(火) 21:40:49
スレタイと>>1の内容の乖離についてチンパンジーのアイちゃんに聴くスレに変わりました


3 :デフォルトの名無しさん:2008/10/28(火) 21:49:40
@乖離←これを右クリでコピーする
Aスタート→すべてのプログラム→アクセサリ→メモ帳を起動
B編集→貼り付け
C編集→すべて選択
D変換キーを押す


4 :デフォルトの名無しさん:2008/10/28(火) 22:17:36
このスレッドは天才チンパンジー「アイちゃん」が
言語訓練のために立てたものです。

アイと研究員とのやり取りに利用するスレッドなので、
関係者以外は書きこまないで下さい。

5 :デフォルトの名無しさん:2008/10/29(水) 05:38:04
>1
ttp://journal.mycom.co.jp/column/architecture/105/index.html


6 :デフォルトの名無しさん:2008/10/29(水) 09:03:39
噴いた

7 :デフォルトの名無しさん:2008/10/29(水) 11:50:27
スレタイに期待して来てみたら

8 :デフォルトの名無しさん:2008/10/29(水) 12:10:13
>1
Verilog にすれば直ると思うよ。

9 :デフォルトの名無しさん:2008/10/29(水) 12:45:19
7セグ使えばいいと思うよ>>1

10 :デフォルトの名無しさん:2008/10/29(水) 12:47:31
こんなスレあったんだ
http://pc11.2ch.net/test/read.cgi/tech/1043858153/l50

11 :デフォルトの名無しさん:2008/11/01(土) 13:09:55
--- 糸冬 了 ---

12 :デフォルトの名無しさん:2008/11/04(火) 01:31:40
良貨は悪貨を駆逐するという言葉が脳裏によぎる

13 :デフォルトの名無しさん:2008/11/07(金) 19:39:27
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